A 265-µW Fractional-N Digital PLL with Seamless Automatic Switching Subsampling/Sampling Feedback Path and Duty-Cycled Frequency-Locked Loop in 65nm CMOS

論文・著書情報

タイトル

和文:
英文:	A 265-µW Fractional-N Digital PLL with Seamless Automatic Switching Subsampling/Sampling Feedback Path and Duty-Cycled Frequency-Locked Loop in 65nm CMOS

著者

和文:	Hanli Liu, Zheng Sun, Hongye Huang, Wei Deng, Teerachot Siriburanon, Jian Pang, Yun Wang, Rui Wu, 染谷晃基, 白根篤史, 岡田健一.
英文:	Hanli Liu, Zheng Sun, Hongye Huang, Wei Deng, Teerachot Siriburanon, Pang Jian, Yun Wang, Rui Wu, 染谷晃基, Atsushi Shirane, Kenichi Okada.

言語

English

掲載誌/書名

和文:
英文:

巻, 号, ページ

出版年月

2019年3月4日

出版者

和文:
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会議名称

和文:	IEEE SSCS Japan Chapter ISSCC報告会
英文:

開催地

和文:	兵庫県神戸
英文: